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互补金属氧化物半导体(CMOS)在过去十年中推动了现代计算机的进步。然而,硅基CMOS现在已经达到了摩尔定律的缩放极限,因此晶体管性能的进一步提高需要材料技术的突破。栅极介电厚度将缩放到10 Å以下,由于电流泄漏和杂质扩散增加,这已达到稳定器件性能的极限。因此,非常需要采用等效氧化物厚度(EOT)小于1 nm的高质量高қ(қ,介电常数)电介质。具有大介电常数和带隙的高κ材料作为栅极电介质可以增强电容并防止小型化技术节点中的漏电流。其中,m-ZrO2因其惰性和相对于SiO2的高қ而显示出良好的潜力,但缺乏生产超薄单晶的方法。
针对该问题,湖南大学刘松教授、香港理工大学冷凯助理教授以共同通讯,湖南大学博士生靳媛媛和中南大学孙健教授为共同第一作者,通过ZrS2的原位热氧化实现了超薄m-ZrO2单晶的可控制备生长的m-ZrO2具有~0.29 nm的等效氧化物厚度,~19的高介电常数和~7.22 MV cm−1的击穿电压。使用m-ZrO2作为介电层的MoS2场效应晶体管(FET)表现出与使用SiO2电介质相当的迁移率。m-ZrO2/MoS2的超洁净界面和m-ZrO2的高晶体质量导致传递曲线的滞后可以忽略不计。单晶m-ZrO2电介质在数字互补金属氧化物半导体逻辑FET中显示出潜在的应用前景。
图1. ZrS2的CVD生长及氧化
以K3[Fe(CN)6]溶液作为种子促进剂旋涂在硅片基底,使用CVD技术可实现高产率大范围ZrS2薄片生长。K3[Fe(CN)6]分子在ZrS2的生长中起重要作用,为晶核生长提供活性位点。因此,具有横向尺寸的大型ZrS2薄片位于K3[Fe(CN)6]旋涂的位置。为了转化为m-ZrO2,ZrS2薄片在空气中(湿度为~20-30%)被热氧化,在加热速率(1°C/min),370 °C下恒温2h形成单晶m-ZrO2。由于m-ZrO2与ZrS2具有不同晶格常数,因此在结构转变过程中会出现厚度变化。通过研究5个具有代表性的不同厚度的ZrS2样品,总结原位热氧化后母体ZrS2与其相应的m-ZrO2的厚度关系。发现两者呈线性关系,线性关系为m-ZrO2 厚度= 0.89×ZrS2厚度-2.3,这为通过监测氧化片的母体ZrS2厚度来控制氧化片的厚度提供了一种很好的方法。
图2. m-ZrO2的介电性能
通过建立电容器件,测试C-V关系,测得m-ZrO2介电常数为~19.3。厚度相关d额介电常数研究显示m-ZrO2介电常数不随厚度减小而降低,随厚度变化不大,保持在~19。漏电流和击穿场也是评估栅极电介质性能的重要因素,其中前者是场效应管静态功耗的主要来源之一。为此,使用厚度为12 nm(EOT~2.46 nm)的m-ZrO2构建器件,通过施加源漏偏置来测量隧道电流、漏电流和击穿场。当场强低于2 MV cm-1时,m-ZrO2的漏电流低于1×10-3 A cm-2,小于1×10-2A cm-2的低功率限值。在7.2 MV cm-1的电场下,隧穿电流开始急剧增加,这决定了击穿场(EBD)。总结该工作制备的介电材料与现有介电材料的性能,从中可以看到m-ZrO2显示出优越的性能。
图3. m-ZrO2作为栅介电的FET性能测试
为了探索m-ZrO2作为栅极电介质的潜力,通过转移~15nm厚的m-ZrO2作为MoS2上的顶部栅极,后者作为沟道材料来制造FET。m-ZrO2/MoS2异质结的AFM图像显示转移的ZrO2片仍然保持无纹波表面,这意味着与MoS2具有良好的附着力。在不同Vds下测得的传输曲线显示出n型行为,当Vds为0.5 V时,开/关比为~105,足以符合104的实用逻辑电路标准。计算出的MoS2 FET的迁移率为~1.3 cm2 V-1 s-1,与使用SiO2作为栅极的MoS2FET相当。从传输曲线中可知低亚阈值斜率(SS)为90 mV,该值接近300 K时~60 mV dec-1的热极限。重要的是,转移曲线显示出可忽略不计的迟滞,表明介电m-ZrO2层的高质量及其与通道材料的清洁接触。栅极电流(Igs)与栅极电压(Vgs)曲线表明 Igs 低至 10-11 A,表明该器件的静态功耗较低。输出曲线显示非线性 Ids-Vds,由于小 EOT 引起的通道夹断,在 Vds= 1 V 时饱和,揭示了金属-半导体触点处的肖特基势垒。
作者简介
原文链接
https://doi.org/10.1002/adma.202212079
相关进展
中南大学孙健教授、罗行副教授《Adv. Mater.》:界面调控的可重构铁电晶体管
中南大学孙健教授课题组《Adv. Mater.》综述:二维半导体器件的费米钉扎效应
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